加法器电路的设计.ppt
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1、9.1 加法器设计,应用 数字信号处理和数字通信 地位 影响系统的运行速度 实现 级联加法器 并行加法器 超前进位加法器 流水线加法器,9.1.1 级连加法器,结构 由1位全加器级连 优点 结构简单 缺点 延时太长,【例9.1】8位级联加法器module add_jl(sum,cout,a,b,cin);output7:0 sum;output cout;input7:0 a,b;input cin;,full_add1 f0(a0,b0,cin,sum0,cin1);full_add1 f1(a1,b1,cin1,sum1,cin2);full_add1 f2(a2,b2,cin2,sum2
2、,cin3);full_add1 f3(a3,b3,cin3,sum3,cin4);full_add1 f4(a4,b4,cin4,sum4,cin5);full_add1 f5(a5,b5,cin5,sum5,cin6);full_add1 f6(a6,b6,cin6,sum6,cin7);full_add1 f7(a7,b7,cin7,sum7,cout);endmodule,1位全加器门级结构原理图,module full_add1(a,b,cin,sum,cout);input a,b,cin;output sum,cout;wire s1,m1,m2,m3;and(m1,a,b),(
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